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[RFW41] モジュールのRTLを配布する予定がありますか? editor 18/5/24(木) 22:57
Re:[RFW41] モジュールのRTLを配布する予定がありま... Hiroyuki Naito 18/5/25(金) 9:38
Re:[RFW41] モジュールのRTLを配布する予定がありま... 森榮 18/5/25(金) 11:41

[RFW41] モジュールのRTLを配布する予定が...
 editor  - 18/5/24(木) 22:57 -
 読者からの質問がございました.他の読者諸兄にも参考になると思われるので,掲示板に転記いたします:

 当該記事に関するソースコードをWeb上からダウンロードしました。中身を見ると、すべてのモジュールのRTLが用意されているわけではないようです。
例えば、p.60〜63に記載のモジュールgen_base_bandは、RTLではなくQuartusのbsfファイルで提供されています。
このようなモジュールのRTLが必要な場合は、該当ページを見て、その通りに自分で手入力しなければならないのでしょうか?今後RTLで配布される予定はないのでしょうか?
引用なし

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Re:[RFW41] モジュールのRTLを配布する予...
 Hiroyuki Naito  - 18/5/25(金) 9:38 -
▼editorさんへ

私は今回の連載で初めてFPGAを扱ってVerilog-HDLでの設計も初めてですが、
モジュールはRTLレベルで開発して、モジュール間の接続や外部とのインター
フェースは回路図(bsf)形式で記述するのはとても分かりやすいやり方だと
思います。

「bsfファイルのRTLが必要な場合」というのがどういう場合なのかはよく
分かりませんが、VHDLでは全体をentity文を使って記述すると周りの人から
聞きました。

すべて回路図というのも煩雑になりすぎますが、すべてHDLのソースに
落としてしまうというのも見えにくくなってしまう部分が出てくるのでは
ないでしょうか。
引用なし

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Re:[RFW41] モジュールのRTLを配布する予...
 森榮  - 18/5/25(金) 11:41 -
▼editorさん:
> 読者からの質問がございました.他の読者諸兄にも参考になると思われるので,掲示板に転記いたします:
>
> 当該記事に関するソースコードをWeb上からダウンロードしました。中身を見ると、すべてのモジュールのRTLが用意されているわけではないようです。
>例えば、p.60〜63に記載のモジュールgen_base_bandは、RTLではなくQuartusのbsfファイルで提供されています。
>このようなモジュールのRTLが必要な場合は、該当ページを見て、その通りに自分で手入力しなければならないのでしょうか?今後RTLで配布される予定はないのでしょうか?


「各モジュールのbsfファイルはダウンロードファイルに入っているようですが、
一部のモジュールのRTLソースコードが見当たりません」
の旨の読者様のご質問への回答は次の通りです。ご質問いただいた読者様以外の方にもご参考にしていただければ幸いです。

「混乱を招き申し訳ありません。 モジュール名とverilogファイル名は必ずしも一致いたしません。
たとえば、 送信機モジュールgen_base_band のソースコードは、
GEN_IF.vファイル内に記載されております。全てのソースコードをダウンロードファイル内に掲載しております。」
引用なし

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