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Re:[RFW41] モジュールのRTLを配布する予定がありますか?
 Hiroyuki Naito  - 18/5/25(金) 9:38 -
▼editorさんへ

私は今回の連載で初めてFPGAを扱ってVerilog-HDLでの設計も初めてですが、
モジュールはRTLレベルで開発して、モジュール間の接続や外部とのインター
フェースは回路図(bsf)形式で記述するのはとても分かりやすいやり方だと
思います。

「bsfファイルのRTLが必要な場合」というのがどういう場合なのかはよく
分かりませんが、VHDLでは全体をentity文を使って記述すると周りの人から
聞きました。

すべて回路図というのも煩雑になりすぎますが、すべてHDLのソースに
落としてしまうというのも見えにくくなってしまう部分が出てくるのでは
ないでしょうか。

引用なし

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[RFW41] モジュールのRTLを配布する予定がありますか? editor 18/5/24(木) 22:57
Re:[RFW41] モジュールのRTLを配布する予定がありま... Hiroyuki Naito 18/5/25(金) 9:38
Re:[RFW41] モジュールのRTLを配布する予定がありま... 森榮 18/5/25(金) 11:41

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